Verilog
Modellbildung für Synthese und Verifikation
Verilog ist die neben VHDL am weitesten verbreitete Hardware-Beschreibungssprache (HDL) für den Entwurf und die Beschreibung elektronischer Schaltkreise und Systeme. Gegenüber VHDL bietet Verilog vor allem den Vorteil der leichteren Erlernbarkeit, da es auf der im Ingenieurbereich weit verbreiteten Sprache C aufgebaut ist. Das Buch von Bernhard Hoppe vermittelt alle relevanten Grundlagen und Anwendungsmöglichkeiten von Verilog und ermöglicht so einen schnellen Einstieg und Überblick. Es ist konzipiert als Lehrbuch für Studierende der Elektrotechnik im Hauptstudium, eignet sich aber auch zum Selbststudium für Berufspraktiker und andere Interessierte. Jedes Kapitel enthält Übungsaufgaben mit Lösungen; dem Buch ist eine CD mit Powerpoint-Folien für den Unterricht, einer Laboranleitung mit Zugang zu der XILINX Studentenversion für den Simulator MODELSIM und Quellcodes beigelegt.
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Autor/in
Bernhard Hoppe
Prof. Dr. Bernhard Hoppe arbeitete von 1986-1989 bei den Siemens Forschungslaboratorien in München und anschließend für vier Jahre am IC-Design-Zentrum der VDO Adolf Schindling. Seit 1993 ist er Professor für Elektrotechnik an der FH Darmstadt und dort seit 2002 Leiter des internationalen Studiengangs "Master of Science in Electrical Engineering".
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